當 ADC0 和 ADC2 一起使用時,ADC0 運行異常。

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你好
我使用 CYT2B98、 CYTVII-B-E-176-SO和CYTVII-B-E-BB EVB 進行了測試。
在 SDL Adc 範例程式碼上測試 ADC0 和 ADC2 函數TLE9243QK_BASE_BOARD時發現問題。
(SDL/TVIIBE2M/例子/ADC/物理通道 _ 到 _ 不同邏輯通道)

根據啟用或停用 ADC2,ADC0 行為有所不同。
-ADC2 禁用:ADC0 轉換數據正常。
-ADC2 啟用:ADC0 轉換數據異常。

 

詳情如下。

  1. SDL adc 示例代碼通過電位器讀取 ADC 的電壓,然後根據 adc 轉換數據打開 LED。
    啟用 ADC2 時,ADC0 轉換資料異常,並確認 LED 行為異常。
  2. 目前,ADC0 和 ADC2 的 PERI_CLK 設置為 13.3 兆赫(與 ADC 示例相同),我確認通過將 ADC0 PERI_CLK 降低到 6.66
    MH 來解決了該問題。
    (即使啟用 ADC2,ADC0 轉換數據也是正常的)

 

Q1)上述問題是否會發生,同時使用 ADC0 和 ADC2 時是否有任何限制? 已確認 ADC2 無論是否已啟動 ADC0,ADC2 都會正常運作,但似乎只有 ADC0 受到 ADC2 影響。

Q2)一起使用 ADC0 和 ADC2 時,PERI_CLK 是否有任何限制?(只使用 ADC0 時,即使 PERI_CLK 設置為 13.3 兆赫,它也可以正常運行)

 

此外,我附加了我測試的代碼。

測試方法

1. MULTICH_CONNECT_PCB JP2.9(P6.0:CYTVII-B-E-BB EVB 的 ADC[0]_0) 至 J89 (ADC_POT) 腳位 1

2. 控制CYTVII-B-E-BB EVB 的 POT1 時 USER_LED 工作

測試代碼(與 SDL adc 示例幾乎相同)

1.套裝 ADC0、ADC2 小時鐘

二.ADC0 初始化

三.每隔 5 秒執行 ADC2 輸入/退入操作。

(可以通過修改第 86 行來測試 ADC0 周時鐘變化。)

 

謝謝

最好的 & 問候

塔格尤納

smartconx_target@Q!w2e3r4t5y6u7i8o9p0||/t5/TRAVEO-T2G/When-ADC0-and-ADC2-are-used-together-ADC0-operates-abnormally/td-p/678044

1 解決方案
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@taegyunahn

對於延遲的回應,抱歉。 請檢查以下內容以獲取答案。

Q1)我設置了 ADC0 和 ADC2(初始化),但只有 ADC0 執行 ADC 開始轉換操作。 在這種情況下,即使共享 SAR 序列器的結果數據匯流排,ADC0 數據不應該存在問題嗎?(當 ADC0 和 ADC2 設置並且 ADC 開始轉換僅在 ADC2 上執行時,ADC2 數據是正常的(只有 ADC0 有問題))

所以基本上 Cy_Adc_Init 函數是啟用 ADC 轉換序列。 一旦我們調用這個 CY_ADC_CHANNEL_SOFTWARETrigger 函數,只有在取樣電容器上採樣的類比輸入信號完成後,才能啟用 ADC 轉換的軟件觸發。 因此,當 ADC0 和 ADC2 的 PCLK_PASS 頻率相同時,那麼這將導致 ADC0 數據上出現問題,因為在 SAR 序列器嘗試從 ADC0 進行後處理數據後處理後,ADC2 數據將中斷。 因此 ADC0 將有數據問題,ADC2 數據將是正常的。

Q2)如果我使用所有 ADC0,ADC1 和 ADC2,我是否需要不同地設置每個 SARADC 的 PCLK?

我如何無問題地使用它? (我計劃使用所有 ADC0,ADC1 和 ADC2)是的,您的理解是
正確的。 對於 CYT2B9,您必須不同地設置每個 SAR ADC 的 PCLK。 如數據表中所示,SAR ADC 的 PCLK 不像 CYT2B7 一樣共享。

Imam_M_0-1706676853196.png

 

然後,您必須設置每個 PCLK 的頻率不同,以確保每個 SAR ADC 的序列在不同的時間。

我希望這回答您的查詢。 謝謝你

smartconx_target@Q!w2e3r4t5y6u7i8o9p0||/t5/TRAVEO-T2G/When-ADC0-and-ADC2-are-used-together-ADC0-operates-abnormally/m-p/686495

在原始文章中檢視解決方案

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7 回應
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@taegyunahn

對於延遲的回應,抱歉。
我們將檢查並儘快回复您。 謝謝你

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@taegyunahn

對於延遲的回應,抱歉。
我們將檢查並儘快回复您。 謝謝你

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@Imam_M

測試證實了什麼嗎?謝謝

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@taegyunahn

對於延遲的回應,抱歉。 您的觀察結果是正確的,我們一直在檢查有關您的查詢的相關文件。 請檢查以下內容以獲取您的查詢中的答案。

Q1)上述問題是否會發生,同時使用 ADC0 和 ADC2 時是否有任何限制?已確認 ADC2 無論是否已啟動 ADC0,ADC2 都會正常運作,但似乎只有 ADC0 受到 ADC2 影響。
基本上,我們不能同時激活多個 SAR ADC。 如 TRM 第 31.5.1 節所述,為了正確操作,溫度EVAL_PASCO2_SENSOR在任何給定時間不應連接到多個 ADC。
同樣如下圖所述,每個 SAR 都有一個分享匯流排與結果數據。 有了這些信息,則無法同時激活 SAR ADC。

Imam_M_0-1706108043458.png
(資料來源:台鐵 T2G 汽車 MCU 車身入口,修正 *I,頁 548)

然後,對於您的下一個觀察,當您嘗試降低 ADC0 的 PCLK 時,您可以實現這一點。 這是因為序列器的時間是差異的。 由於具有此條件,ADC0 和 ADC2 處理 SAR 操作的矩並不同時間。 然後我認為在這種情況下,ADC0 和 ADC2 可能能夠正常工作。 再次,具有不同的 PCLK 頻率。


Q2)一起使用 ADC0 和 ADC2 時,PERI_CLK 是否有任何限制?(只使用 ADC0 時,即使 PERI_CLK 設置為 13.3 兆赫,它也可以正常運作)
請參考問題號 1
的答案。

我希望這回答您的查詢。 謝謝你

smartconx_target@Q!w2e3r4t5y6u7i8o9p0||/t5/TRAVEO-T2G/When-ADC0-and-ADC2-are-used-together-ADC0-operates-abnormally/m-p/682955

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@Imam_M

謝謝你的回答。
我有其他問題如下。

 

Q1)我設置了 ADC0 和 ADC2(初始化),但只有 ADC0 執行 ADC 開始轉換操作。在這種情況下,即使共享 SAR 序列器的結果數據匯流排,ADC0 數據不應該存在問題嗎?(當 ADC0 和 ADC2 設置並且 ADC 開始轉換僅在 ADC2 上執行時,ADC2 數據是正常的(只有 ADC0 有問題))

Q2)如果我使用所有 ADC0,ADC1 和 ADC2,我是否需要不同地設置每個 SARADC 的 PCLK?我如何無問題地使用它?(我計劃使用所有 ADC0,ADC1 和 ADC2)

 

最好的 & 問候

謝謝你

太古納。

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@Imam_M

有什麼進一步確認嗎? 謝謝你

太古納。

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@taegyunahn

對於延遲的回應,抱歉。 請檢查以下內容以獲取答案。

Q1)我設置了 ADC0 和 ADC2(初始化),但只有 ADC0 執行 ADC 開始轉換操作。 在這種情況下,即使共享 SAR 序列器的結果數據匯流排,ADC0 數據不應該存在問題嗎?(當 ADC0 和 ADC2 設置並且 ADC 開始轉換僅在 ADC2 上執行時,ADC2 數據是正常的(只有 ADC0 有問題))

所以基本上 Cy_Adc_Init 函數是啟用 ADC 轉換序列。 一旦我們調用這個 CY_ADC_CHANNEL_SOFTWARETrigger 函數,只有在取樣電容器上採樣的類比輸入信號完成後,才能啟用 ADC 轉換的軟件觸發。 因此,當 ADC0 和 ADC2 的 PCLK_PASS 頻率相同時,那麼這將導致 ADC0 數據上出現問題,因為在 SAR 序列器嘗試從 ADC0 進行後處理數據後處理後,ADC2 數據將中斷。 因此 ADC0 將有數據問題,ADC2 數據將是正常的。

Q2)如果我使用所有 ADC0,ADC1 和 ADC2,我是否需要不同地設置每個 SARADC 的 PCLK?

我如何無問題地使用它? (我計劃使用所有 ADC0,ADC1 和 ADC2)是的,您的理解是
正確的。 對於 CYT2B9,您必須不同地設置每個 SAR ADC 的 PCLK。 如數據表中所示,SAR ADC 的 PCLK 不像 CYT2B7 一樣共享。

Imam_M_0-1706676853196.png

 

然後,您必須設置每個 PCLK 的頻率不同,以確保每個 SAR ADC 的序列在不同的時間。

我希望這回答您的查詢。 謝謝你

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