一月 10, 2020
04:26 AM
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一月 12, 2020
11:51 PM
可以为地址引脚(A)分配任何位顺序。 只有A1和A0必须具有特定的位顺序, 这些位是实现SRAM突发功能所必需的。 这些引脚的硬件接线可确保将数据写入和读取所需的位置。
IO引脚(DQ)也可以分配任何位顺序,包括字节使能功能,以简化具有动态总线设备的设计。
参考Address and I/O Pin Order Flexibility for the Standard Synchronous and NoBL™ SRAMs
数据手册中Boundary Scan Order的表格中bit和ball ID表示 SCAN 的这些位的连接顺序,每一位对应于SRAM封装上的一个焊球。这个不是指导硬件设计的。
Roy Liu
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