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PSoC™ 4

JuIn_1625121
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PSoC4のSWDデータポートは入出力ピンとなっているかと存じますが、

こちら内部プルアップなどされておりますでしょうか?

miniprog3などの未接続時はオープンとなるため、ノイズ耐性について確認したく考えております。

また、もし耐性を上げる処理などあればご教示下さい。

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AikoO_51
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特定のデバイスに対する調査に関しまして、現在少し時間がかかってしまっておりますが、通常SWD ラインに内部プルアップは実装されておりません。

外部プルアップ抵抗を実装することは可能です。

Aiko Ohtaka
Infineon Technologies

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AikoO_51
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具体的にPSoC4 のどのデバイスに対してでしょうか。

各PSoC4デバイスのDevelopment Kitのページに回路図も掲載されておりますので、そちらもご参照いただけます。

Aiko Ohtaka
Infineon Technologies
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JuIn_1625121
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お世話になっております。

デバイスは

CY8C4024LQI-S411T

になります。

kit類についてはSWDポートの先にkitprogが接続されているか、

オープンのものは特に外部回路での耐ノイズ処理などは行われていないかと存じます。

以上、よろしくお願いいたします。

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AikoO_51
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特定のデバイスに対する調査に関しまして、現在少し時間がかかってしまっておりますが、通常SWD ラインに内部プルアップは実装されておりません。

外部プルアップ抵抗を実装することは可能です。

Aiko Ohtaka
Infineon Technologies
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