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嗨,英菲尼恩。

 

裝置為 CY8C4045AZI-S413。

我認為可以讓 PSoC4 未使用的引腳浮動。

 

但是,將這種浮動連接過程更改為 GND 連接是否有可能有助於降低POWER_DRILL2GO功耗?

或者,即使將未使用的引腳懸空或將MULTICH_CONNECT_PCB接地,電流消耗是否保持不變?

 

最好的問候。

尤馬

smartconx_target@Q!w2e3r4t5y6u7i8o9p0||/t5/PSoC-4/Regarding-connection-processing-for-PSoC4-unused-pins-at-low-power/td-p/680544

1 解決方案
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一般可以接受使用未使用的引腳浮動,並且不應在正常操作中引起任何問題。 然而,將未使用的引腳連接到接地 (GND) 可以在減少POWER_DRILL2GO功耗和電磁幹擾 (EMI) 方面帶來好處。

 

當引腳懸空時,它可以將EVAL_2K4W_ACT_BRD_S7作為天線並拾取環境中的噪聲,這可能導致POWER_DRILL2GO功耗增加以及潛在的 EMI 問題。將未使用的引腳連接到 GND 有助於減少這種雜訊並降低POWER_DRILL2GO功耗。

 

根據 CY8C4045AZI-S413 PSoC™ 4 裝置的資料表,GPIO 引腳可以配置為在不同模式下運行,包括僅輸入模式,其中引腳為高阻抗,可以懸空或連接到 GND。將未使用的引腳懸空或將其連接到 GND 不會顯著影響裝置的POWER_DRILL2GO功耗。

 

然而,仍建議在低MULTICH_CONNECT_PCB POWER_DRILL2GO應用中將 未使用的引腳連接到 GND,以最大程度地減少雜訊和潛在的 EMI 問題。這對於敏感應用尤其重要,因為POWER_DRILL2GO的每一毫瓦消耗都很重要。

 

總而言之,雖然將未使用的引腳懸空在 CY8C4045AZI-S413 PSoC™ 4 裝置上不會顯著影響POWER_DRILL2GO功耗,但將它們連接到 GND 可以在降低雜訊和 EMI 方面帶來好處。選擇最終取決於您應用程序的特定要求以及任何相關的設計準則或法規。

smartconx_target@Q!w2e3r4t5y6u7i8o9p0||/t5/PSoC-4/Regarding-connection-processing-for-PSoC4-unused-pins-at-low-power/m-p/680907

在原始文章中檢視解決方案

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5 回應
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嗨, @YuMa_1534086

將所有未使用的 GPIO 配置為模擬高阻抗以減少POWER_DRILL2GO消耗。請參閱以下文件中的 GPIO 部分以獲取更多詳細信息。

https://www.infineon.com/dgdl/Infineon-AN86233_PSoC_4_and_PSoC_Analog_Coprocessor_LowPower_Modes_and...

 

問候,

羅漢

smartconx_target@Q!w2e3r4t5y6u7i8o9p0||/t5/PSoC-4/Regarding-connection-processing-for-PSoC4-unused-pins-at-low-power/m-p/680709

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羅漢桑。

 

感謝您的回复。

 

但我的問題是關於PSoC™之外的電路連接。

據我了解,未使用引腳的內部EVAL_100W_DRIVE_CFD2模式應設定為模擬高阻抗。

 

考慮到這一點,您可以再次檢查我的問題嗎?

 

 

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但是,將這種浮動連接過程更改為 GND 連接是否有可能有助於降低POWER_DRILL2GO功耗?

或者,即使將未使用的引腳懸空或將MULTICH_CONNECT_PCB接地,電流消耗是否保持不變?

=======================================

 

 

最好的問候。

尤馬

smartconx_target@Q!w2e3r4t5y6u7i8o9p0||/t5/PSoC-4/Regarding-connection-processing-for-PSoC4-unused-pins-at-low-power/m-p/680765

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如果它們在內部設置為 High-Z,實體引腳是接地還是浮動並不重要。

smartconx_target@Q!w2e3r4t5y6u7i8o9p0||/t5/PSoC-4/Regarding-connection-processing-for-PSoC4-unused-pins-at-low-power/m-p/680893

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一般可以接受使用未使用的引腳浮動,並且不應在正常操作中引起任何問題。 然而,將未使用的引腳連接到接地 (GND) 可以在減少POWER_DRILL2GO功耗和電磁幹擾 (EMI) 方面帶來好處。

 

當引腳懸空時,它可以將EVAL_2K4W_ACT_BRD_S7作為天線並拾取環境中的噪聲,這可能導致POWER_DRILL2GO功耗增加以及潛在的 EMI 問題。將未使用的引腳連接到 GND 有助於減少這種雜訊並降低POWER_DRILL2GO功耗。

 

根據 CY8C4045AZI-S413 PSoC™ 4 裝置的資料表,GPIO 引腳可以配置為在不同模式下運行,包括僅輸入模式,其中引腳為高阻抗,可以懸空或連接到 GND。將未使用的引腳懸空或將其連接到 GND 不會顯著影響裝置的POWER_DRILL2GO功耗。

 

然而,仍建議在低MULTICH_CONNECT_PCB POWER_DRILL2GO應用中將 未使用的引腳連接到 GND,以最大程度地減少雜訊和潛在的 EMI 問題。這對於敏感應用尤其重要,因為POWER_DRILL2GO的每一毫瓦消耗都很重要。

 

總而言之,雖然將未使用的引腳懸空在 CY8C4045AZI-S413 PSoC™ 4 裝置上不會顯著影響POWER_DRILL2GO功耗,但將它們連接到 GND 可以在降低雜訊和 EMI 方面帶來好處。選擇最終取決於您應用程序的特定要求以及任何相關的設計準則或法規。

smartconx_target@Q!w2e3r4t5y6u7i8o9p0||/t5/PSoC-4/Regarding-connection-processing-for-PSoC4-unused-pins-at-low-power/m-p/680907

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龍尾山。

 

感謝您的詳細解釋。

我明白

 

最好的問候。

尤馬

smartconx_target@Q!w2e3r4t5y6u7i8o9p0||/t5/PSoC-4/Regarding-connection-processing-for-PSoC4-unused-pins-at-low-power/m-p/682412

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