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こんにちは:今lは、lがBDRVクロック構成TLE9879を開発するとき、lがアッパーディザとローディザ周波数を設定するために構成ウィザードツールを使用するとき、l CAN コンフィグ値とregister.whyアッパーディザFreq = 243Khzの関係を理解していない、レジスタF_CP=0X02 DITH_UPPER = 0X0A、TLE9879データシートに説明はありません。

xjs286268_1-1692944791001.png

 

 

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こんにちは @xjs286268 

アッパーディザ周波数の場合:

Fup = Fclock_source /(Fcp & FDITH_UPPER) = 18000000 /( 10(0x2) 1010(0x0A)) = 18000000/74 = 243.24kHz

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こんにちは @xjs286268 

アッパーディザ周波数の場合:

Fup = Fclock_source /(Fcp & FDITH_UPPER) = 18000000 /( 10(0x2) 1010(0x0A)) = 18000000/74 = 243.24kHz

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