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cross mob
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RefreshCollision.PNG

 

1. 計時圖顯示寫入週期期間的參考衝突。 RWDS 更改中間命令。 這是預期的行為還是模擬錯誤? 在哪裡是採樣 RWDS 以進行延長延遲的理想點? 數據表中不清楚。

二.在過去的帖子中,我的問題導致了與刷新碰撞相關的 verilog 模型更新。 我最近下載了標記為 4.0 的最新型號,並發現它不是 infineon 在這個論壇上親自給我的最新型號。

smartconx_target@Q!w2e3r4t5y6u7i8o9p0||/t5/Hyper-RAM/HyperRAM-Refresh-Collision-Verilog-Model/td-p/664017

1 回應
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你好 @GeFu_3059156

您是否指的是下面的社區主題?

https://community.infineon.com/t5/Hyper-RAM/HyperRAM-RWDS-Refresh-Collision-Timing/m-p/404738#M320

您正在尋找的 Verilog 模型是用於同一部分嗎? 如果不是,請與我分享部分號。

最好的問候,

阿德許

 

smartconx_target@Q!w2e3r4t5y6u7i8o9p0||/t5/Hyper-RAM/HyperRAM-Refresh-Collision-Verilog-Model/m-p/664393

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