Community Translation - Changing the priority of PSoC™ 6 AHB interface masters - KBA233889

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Dear supporter

I would like to translate the following KBA into Japanese, Please confirm to my work.

Changing the priority of PSoC™ 6 AHB interface masters - KBA233889

https://community.infineon.com/t5/Knowledge-Base-Articles/Changing-the-priority-of-PSoC-6-AHB-interf...


Best Regards,
Kumada

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Hi Jenna-san

I translated the KBA into Japanese as below.

We would appreciate it if you could confirm.

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PSoC™6 AHBインターフェースマスタの優先順位の変更 - KBA233889

バージョン: **


背景

PSoC™ 6 MCUは、Arm® CM4 CPUコア、Arm® CM0 CPUコア、Datawire0、Datawire1、Crypto、デバッグ アクセス ポート(DAP)など、複数のArm®仕様の高度な高性能バス(AHB)インターフェース マスタを搭載しています。

異なるバスマスタが同時にアクセスしようとする可能性があるため、バス上のデータ移動へのアクセスは、他のマスタとの調停に従うことになります。ディスクリプタやデータのフェッチなどのアクションは、調停によって停止する可能性があります。これらのマスタがAHB上で持つバス調停優先順位を設定することが可能です。

 

シナリオ例

例えば、プロジェクトで Datawire0 と Datawire1 の両方を使用している場合、Datawire0 を Datawire1 よりも優先的に使用する方法、またはその逆の方法はありますか。

 

解決方法

バスの調停は、PROT_SMPU_MSx_CTL レジスタの PRIO ビットで設定された調停スキームに基づいて行われます。バスマスタには、それぞれ PROT_SMPU_MSx_CTL レジスタが対応しています。PROT_SMPU_MSx_CTL レジスタの PRIO ビット(ビット 8、9)に 0(最優先)を書き込むことにより、バスの優先順位を上げることができます。詳細については、PSoC™6 デバイスの各レジスタ TRM(テクニカルリファレンスマニュアル) を参照してください。

どの PROT_SMPU_MSx_CTL レジスタに書き込むかについては、次の画像のように、.....project_workspace\mtb_shared\mtb-pdl-cat1\release-v2.2.0\devices\COMPONENT_CAT1A\include ディレクトリに存在する psoc6_02_config.h ファイル(PSoC™62の場合)を参照してください。

Chelladurai_0-1632807169786.png

 en_prot_master_t 列挙型には、さまざまなバスマスタとそれに対応する PROT_SMPU_MSx_CTL レジスタが含まれています。

上記の例では、Datawire0 のバス優先度を上げるか下げるかを決定するために、PROT_SMPU_MS2_CTL レジスタに書き込む必要があります。同様に、DMA コントローラでは、PROT_SMPU_MS4_CTL レジスタに書き込む必要があります。

注:同じ優先度設定のマスターは、「優先度グループ」を形成します。「優先度グループ」内では、ラウンドロビンによる調停が行われます。

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Best Regards,

Kumada

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JennaJo
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Hi, Kumada-san

Confirm to work this KBA.

If you have any question, please let me know. 

Jenna Jo
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Hi Jenna-san

I translated the KBA into Japanese as below.

We would appreciate it if you could confirm.

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PSoC™6 AHBインターフェースマスタの優先順位の変更 - KBA233889

バージョン: **


背景

PSoC™ 6 MCUは、Arm® CM4 CPUコア、Arm® CM0 CPUコア、Datawire0、Datawire1、Crypto、デバッグ アクセス ポート(DAP)など、複数のArm®仕様の高度な高性能バス(AHB)インターフェース マスタを搭載しています。

異なるバスマスタが同時にアクセスしようとする可能性があるため、バス上のデータ移動へのアクセスは、他のマスタとの調停に従うことになります。ディスクリプタやデータのフェッチなどのアクションは、調停によって停止する可能性があります。これらのマスタがAHB上で持つバス調停優先順位を設定することが可能です。

 

シナリオ例

例えば、プロジェクトで Datawire0 と Datawire1 の両方を使用している場合、Datawire0 を Datawire1 よりも優先的に使用する方法、またはその逆の方法はありますか。

 

解決方法

バスの調停は、PROT_SMPU_MSx_CTL レジスタの PRIO ビットで設定された調停スキームに基づいて行われます。バスマスタには、それぞれ PROT_SMPU_MSx_CTL レジスタが対応しています。PROT_SMPU_MSx_CTL レジスタの PRIO ビット(ビット 8、9)に 0(最優先)を書き込むことにより、バスの優先順位を上げることができます。詳細については、PSoC™6 デバイスの各レジスタ TRM(テクニカルリファレンスマニュアル) を参照してください。

どの PROT_SMPU_MSx_CTL レジスタに書き込むかについては、次の画像のように、.....project_workspace\mtb_shared\mtb-pdl-cat1\release-v2.2.0\devices\COMPONENT_CAT1A\include ディレクトリに存在する psoc6_02_config.h ファイル(PSoC™62の場合)を参照してください。

Chelladurai_0-1632807169786.png

 

 en_prot_master_t 列挙型には、さまざまなバスマスタとそれに対応する PROT_SMPU_MSx_CTL レジスタが含まれています。

上記の例では、Datawire0 のバス優先度を上げるか下げるかを決定するために、PROT_SMPU_MS2_CTL レジスタに書き込む必要があります。同様に、DMA コントローラでは、PROT_SMPU_MS4_CTL レジスタに書き込む必要があります。

注:同じ優先度設定のマスターは、「優先度グループ」を形成します。「優先度グループ」内では、ラウンドロビンによる調停が行われます。

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Best Regards,

Kumada

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Hi Jenna-san

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PSoC™6 AHBインターフェースマスタの優先順位の変更 - KBA233889

バージョン: **


背景

PSoC™ 6 MCUは、Arm® CM4 CPUコア、Arm® CM0 CPUコア、Datawire0、Datawire1、Crypto、デバッグ アクセス ポート(DAP)など、複数のArm®仕様の高度な高性能バス(AHB)インターフェース マスタを搭載しています。

異なるバスマスタが同時にアクセスしようとする可能性があるため、バス上のデータ移動へのアクセスは、他のマスタとの調停に従うことになります。ディスクリプタやデータのフェッチなどのアクションは、調停によって停止する可能性があります。これらのマスタがAHB上で持つバス調停優先順位を設定することが可能です。

 

シナリオ例

例えば、プロジェクトで Datawire0 と Datawire1 の両方を使用している場合、Datawire0 を Datawire1 よりも優先的に使用する方法、またはその逆の方法はありますか。

 

解決方法

バスの調停は、PROT_SMPU_MSx_CTL レジスタの PRIO ビットで設定された調停スキームに基づいて行われます。バスマスタには、それぞれ PROT_SMPU_MSx_CTL レジスタが対応しています。PROT_SMPU_MSx_CTL レジスタの PRIO ビット(ビット 8、9)に 0(最優先)を書き込むことにより、バスの優先順位を上げることができます。詳細については、PSoC™6 デバイスの各レジスタ TRM(テクニカルリファレンスマニュアル) を参照してください。

どの PROT_SMPU_MSx_CTL レジスタに書き込むかについては、次の画像のように、.....project_workspace\mtb_shared\mtb-pdl-cat1\release-v2.2.0\devices\COMPONENT_CAT1A\include ディレクトリに存在する psoc6_02_config.h ファイル(PSoC™62の場合)を参照してください。

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 en_prot_master_t 列挙型には、さまざまなバスマスタとそれに対応する PROT_SMPU_MSx_CTL レジスタが含まれています。

上記の例では、Datawire0 のバス優先度を上げるか下げるかを決定するために、PROT_SMPU_MS2_CTL レジスタに書き込む必要があります。同様に、DMA コントローラでは、PROT_SMPU_MS4_CTL レジスタに書き込む必要があります。

注:同じ優先度設定のマスターは、「優先度グループ」を形成します。「優先度グループ」内では、ラウンドロビンによる調停が行われます。

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Best Regards,

Kumada

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Hi Kumada-san,

Confirm to receive this KBA. 

Thank you for your Contribution. 

Thanks,
Mohammed

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