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DMA和CPU同时访问SRAM会造成什么后果

DMA和CPU同时访问SRAM会造成什么后果

ASUS
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使用TC387芯片,定时器触发VADC采样,采样完成后触发DMA搬运,将VADC的结果寄存器搬运到SRAM中的结构体,并产生Core2的中断,在Core2的中断里读取结构体中的采样结果,这一切都貌似没问题。

但是如果Core1和Core0也会访问这个结构体,就会存在可能Core0/1在访问结构体的过程中DMA向结构体搬运数据,或DMA向结构体搬运数据过程中Core0/1访问结构体,这样会出现什么后果?会不会造成数据的前2个字节和后2个字节不匹配的情况?该如何解决?

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